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神奈川県厚木市【設計・電気・電子・機械・】9時半始業 CISのデジタル回路設計・電力解析業務の募集内容
★9時半始業★CISのデジタル回路設計・電力解析業務
募集内容
- 職種
- 設計・電気・電子・機械・
- 仕事内容
- 大手半導体製造メーカーでのお仕事です。
CIS デジタル回路設計:
開発要求仕様に基づいた回路仕様作成、Verilog-HDL/SystemCによる設計および検証(リファレンスCによる一致検証、アサーション検証、波形目視、カバレッジ検証など。)。設計後は評価チーム、試作・量産立ち上げサポートも行います。設計委託メンバとの業務やりとりも行います。
特に電力解析、チェックツール実行(構文チェック、非同期検証)、簡易論理合成、SDC(物理インプリ制約)作成の業務を担っていただきます。
◆使用ツール・スキル:Excel、PowerPoint、HDLシミュレータ : IUS、チェッカー : Spyglass Checker、 SpyglassCDC、 JasperGold、 Verdi 物理インプリ実装ツール : design compiler、formality、primetime
★9時半始業★CISのデジタル回路設計・電力解析業務
■<大手系列でスキルアップ!>イメージセンサーのデジタル回路設計業務!本厚木エリアでお仕事をお探しの方にオススメ☆ご応募お待ちしております!
■即日~長期(3ヶ月以上)
★勤務スタート日はご相談可能です。ご就業中の方もお気軽にご相談ください。
- 勤務地
- [神奈川県厚木市]神奈川県厚木市<最寄駅>・小田急線 本厚木駅
- 勤務時間
- 09:30~18:00 実働7時間45分 休憩45分 残業は30~40(時間/月)です。
- 休日
- 完全週休2日制(土日祝休み) ※企業カレンダーによる
- 給与
- 時給3,600円
【月収例】55万8000円=時給3600円×155時間(残業代別途)
★時給は経験・スキルによって優遇します。
- 雇用形態
- 派遣社員
- 資格・経験
- 【こんなスキルや経験のある方を歓迎します!】 ・半導体のデジタル回路設計スキル
・Verilog-HDL 設計検証スキル (5年以上)
・物理インプリ実装ツールに関する知見 (design compiler、 formality、 primetime)
・他チームと連携しながら遂行する主体性
【活かせる経験】 ・クロック・リセット制御回路、DFT設計知見
・アナログ回路の基礎知識
・CMOSイメージセンサの基礎知識
- 待遇
- 各種社会保険完備(雇用・労災・健康・厚生年金)
有休休暇
定期健康診断
- 備考
- ◆職場の環境:【たばこ:禁煙】
- 管理NO
- sse812806
- 社会保険
- 健康保険あり,厚生年金あり,雇用保険あり,労災保険あり
- 試用期間
- なし
- 喫煙環境
- 禁煙
ご応募について
- 応募方法
-
まずは『WEB応募ボタン』よりご応募下さい。
※お電話でのお問い合わせもOKです。
★来社不要なオンライン登録をご用意しております。
簡単手続きでスムーズに登録できます。
※【@staffservice.ne.jp】からのメールが受信できるようドメイン解除をお願い致します。
【登録完了までの流れ】
応募後に、ご登録のご案内メールが届きますので
メール内URLよりご登録ください!
PCや携帯より、登録情報をご入力いただきます。
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ご登録完了!お仕事のご紹介をスタートします!
- ご応募後について
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応募完了後、応募時に入力していただいたメールアドレス・電話番号(SMS)宛に、
応募企業とのメッセージのやり取りを開始するために通知をする可能性がございます。
- 受付先名
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スタッフサービス・エンジニアリング 神奈川HRセンター
〒220-8113 神奈川県横浜市西区みなとみらい2-2-1 横浜ランドマークタワー13階
TEL:0120-022-624
掲載開始日:2026年06月22日
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